[자연과학]전자물리實驗보고서 - 전치증폭기 實驗
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작성일 22-10-14 00:01
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그래서 양단 전압은 영이 된다 도입된 가상접지 관념은 연산증폭기를 이용한 회로해석에서 중요한 역할을 한다.
실험과제/물리
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[자연과학]전자물리實驗보고서 - 전치증폭기 實驗
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설명
순서
전치증폭기
Inverting (반전)
Non-Inverting (비반전)
Differential Amplifier (차동증폭기)
Preamplifier (전치증폭기)
○ Inverting & Non-Inverting
반전증폭기(Inverting)와 비반전증폭기(Non-Inverting)가 연산증폭기의 기본회로이다. 그러나, 이 단락현상을 물리적인 실제적단락이 아니기에 이를 가상접지라고 한다. 비반전증폭기는 입력전압과 출력전압의 위상차이가 영이고, 반전증폭기에서는 입력전압과 출력전압의 위상차이는 역상인 180°이다.
1) Inverting
그림 1 반전증폭기
그림 1의 삼각형 모양이 증폭기 기호이고 그안의 무한대기호는 이상적인 연산증폭기임을 의미한다. 가상접지에 의해 증폭기의 입력전압은 0이 되고, 신호저항은 무한대가 되기 때문에 입력단자로 전류가 들어가지 않는다.
우측의 R1이 입력저항이고, 출력전압은 0Ω이 된다
전압증폭도(신호전압과 출력전압의 비)
이상적인 연산증폭기는 주파수에 상관없이 R1과 R2의 비인 위의 전압증폭도가 적용된다 위 식에서 저항앞에 -부호를 넣은 것은 Vs와 Vo의 위상차가 180°라는걸 의미한다. 여기서 접지한 회로가 단락되었음을 가리킨다.(반전)
2) Non-Inverting
그림 2 비반전증폭기
비반전증폭기는 출력단자와 반전입력단자 (-)에 저항이 연결되어 있는데 이를 부궤환이라고 한다. 그리고 (+)에 연결되면 정궤환이라고하는데 정궤환의 구성은 증폭기가 아니다. 연산증폭기의 입력저항이 무한대이기에 입력단자로 전류가 유입될 수없다.
※ 가상 접지 (virtual ground)
이상적인 연산증폭기는 전압이득이 무한대가 된다
증폭기 입력단자간의 전압은 영(zero)이 되고 이는 단락을 의미한다. (-)에 …(skip)
다.
